梁 娟

(新疆工業(yè)職業(yè)技術(shù)學(xué)院 能源與電氣工程系，烏魯木齊 830022)

基于CMOS工藝的自動(dòng)增益控制電路研究

梁 娟

(新疆工業(yè)職業(yè)技術(shù)學(xué)院 能源與電氣工程系，烏魯木齊 830022)

在無(wú)線接收機(jī)中，天線接收的信號(hào)強(qiáng)度往往變化很大，自動(dòng)增益控制環(huán)路(automatic gain control，AGC)根據(jù)這個(gè)信號(hào)強(qiáng)度來(lái)動(dòng)態(tài)調(diào)節(jié)控制放大器的增益，向后級(jí)基帶電路(如ADC)提供幅度恒定的信號(hào)，使得接受到的不同強(qiáng)度信號(hào)均能被正確接收和解調(diào)；為了達(dá)到通過(guò)識(shí)別接收機(jī)接收信號(hào)的強(qiáng)度動(dòng)態(tài)調(diào)節(jié)放大器的增益，以實(shí)現(xiàn)輸出信號(hào)幅度恒定的目的，文章基于TSMC90nm CMOS工藝著重論述了針對(duì)70 MHz中頻信號(hào)的AGC電路設(shè)計(jì)過(guò)程，詳細(xì)設(shè)計(jì)了AGC各模塊電路，并從提高線性度、降低直流失調(diào)和提高穩(wěn)定性等方面對(duì)電路進(jìn)行了優(yōu)化，主要介紹AGC芯片的版圖設(shè)計(jì)并進(jìn)行了后仿，給出了整個(gè)AGC系統(tǒng)的工作特性和各項(xiàng)指標(biāo)；在電路設(shè)計(jì)過(guò)程中，針對(duì)線性度、輸出信號(hào)幅度、增益控制范圍等進(jìn)行改進(jìn)與優(yōu)化，得到符合設(shè)計(jì)指標(biāo)的電路結(jié)構(gòu)；最后對(duì)AGC環(huán)路的性能進(jìn)行仿真驗(yàn)證，得到該AGC在滿(mǎn)足輸出信號(hào)幅度和線性度的基礎(chǔ)上達(dá)到了30 dB的動(dòng)態(tài)范圍，滿(mǎn)足了接收機(jī)系統(tǒng)的要求。

CMOS；自動(dòng)增益控制；可變?cè)鲆娣糯笃?；dB線性；1 dB壓縮點(diǎn)

0 引言

科學(xué)技術(shù)的發(fā)展日新月異，在過(guò)去十幾年中，以手機(jī)等無(wú)線設(shè)備終端為代表的無(wú)線通信產(chǎn)品的快速普及和更新?lián)Q代使得我們的工作方式和生活方式都發(fā)生了巨大而深刻的變化。在無(wú)線接收機(jī)中，由于信道是非理想的且處于不斷變化中，天線從外部接收到的信號(hào)強(qiáng)度也是變化的。為了保證良好的接收效果，在接收機(jī)中通常使用自動(dòng)增益控制，自動(dòng)增益控制(AGC)系統(tǒng)可以用于混頻前的射頻放大級(jí)，但主要是應(yīng)用于中頻放大級(jí)。本文以無(wú)線接收機(jī)為背景，設(shè)計(jì)了一款增益動(dòng)態(tài)范圍為30 dB的AGC電路，論述了其基本原理和設(shè)計(jì)方法，并對(duì)其進(jìn)行了仿真驗(yàn)證。

1 自動(dòng)增益控制電路設(shè)計(jì)方案

本文希望設(shè)計(jì)一款可以應(yīng)用于70 MHz中頻的增益連續(xù)可調(diào)的放大器，這就要求我們應(yīng)選擇模擬型AGC環(huán)路且3 dB帶寬包含70 MHz。接收機(jī)對(duì)本級(jí)增益動(dòng)態(tài)范圍要求是大于30 dB，考慮到單級(jí)VGA實(shí)現(xiàn)30 dB動(dòng)態(tài)范圍比較極限，并且要剔除增益誤差較大和失真嚴(yán)重的增益區(qū)間段，為保證設(shè)計(jì)裕量，應(yīng)至少使用兩級(jí)VGA結(jié)構(gòu)。但級(jí)聯(lián)級(jí)數(shù)也不易過(guò)多，否則會(huì)增加電路設(shè)計(jì)難度，同時(shí)帶來(lái)級(jí)間失調(diào)等問(wèn)題，綜合考慮本文采用兩級(jí)級(jí)聯(lián)的吉爾伯特單元的形式。

由于后級(jí)ADC精度及動(dòng)態(tài)范圍的限制，AGC輸出差分信號(hào)幅度應(yīng)到達(dá)250～450 mV，同時(shí)較大的輸出信號(hào)幅度也有利于提高峰值檢測(cè)器的檢測(cè)精度，然而下混頻后的信號(hào)幅度(功率)較小，通常VGA的增益的絕對(duì)值并不是很大，甚至包含負(fù)增益，所以需要一個(gè)固定增益級(jí)(Fix Gain Amplifier)來(lái)抬高AGC的整體增益的絕對(duì)值。固定增益級(jí)同時(shí)也起到一個(gè)緩沖器(Buffer)的作用，不論是后級(jí)ADC的輸入阻抗還是測(cè)試時(shí)作為AGC負(fù)載的電路板走線和測(cè)試儀器，它們通?？梢缘刃橐粋€(gè)較大的容性負(fù)載，固定增益級(jí)的加入使得整個(gè)AGC可以適用于不同的負(fù)載阻抗而不會(huì)影響VGA的頻率特性，降低了VGA的設(shè)計(jì)難度，增強(qiáng)了AGC的可移植性，給其它部分的設(shè)計(jì)帶來(lái)了更多裕度。

由于輸入到輸出，信號(hào)經(jīng)過(guò)了兩級(jí)VGA和一個(gè)固定增益級(jí)，所以級(jí)間失調(diào)是一個(gè)很大的問(wèn)題，為此本設(shè)計(jì)將在VGA中加入直流失調(diào)消除電路。整個(gè)AGC方案如圖1所示。

圖1 AGC整體結(jié)構(gòu)框圖

無(wú)線接收機(jī)系統(tǒng)對(duì)本文所設(shè)計(jì)的中頻AGC系統(tǒng)的性能指標(biāo)要求如表1所示。

表1 AGC系統(tǒng)性能要求

2 自動(dòng)增益控制電路基本模塊設(shè)計(jì)

2.1 可變?cè)鲆娣糯笃?VGA)設(shè)計(jì)與仿真

兩級(jí)VGA整體電路框圖如圖2所示，控制電壓CV經(jīng)增益特性控制電路產(chǎn)生電流IC1和IC2，控制兩級(jí)VGA的主體增益級(jí)，產(chǎn)生dB線性的控制特性，每級(jí)VGA包含一個(gè)共模負(fù)反饋電路和直流消除電路來(lái)穩(wěn)定電路的靜態(tài)工作點(diǎn)并減小直流失調(diào)的影響。

圖2 兩級(jí)VGA電路框圖

圖3是不同控制電壓下兩級(jí)VGA的幅頻特性仿真，由于引入了直流失調(diào)消除電路，所以幅頻特性整體呈現(xiàn)一個(gè)帶通的形式，由于米勒效應(yīng)的影響，不同增益下電路帶寬不同，圖中曲線從下到上對(duì)應(yīng)的依次為0到1.2 V，從圖中可以看出當(dāng)增益達(dá)到最大值時(shí)，電路的3 dB帶寬最小，最小帶寬為21.2～166.0 MHz。

圖3 不同控制電壓下兩級(jí)VGA的幅頻特性仿真

通常情況下，增益越大電路對(duì)失調(diào)越敏感，所以在最高增益下，我們對(duì)加入失調(diào)消除電路前后進(jìn)行Monte Carlo仿真，如圖4所示。設(shè)置差分輸出端OP和ON的直流電平的差值作為隨機(jī)變量，統(tǒng)計(jì)100次的仿真結(jié)果，圖中“mu”代表可以隨機(jī)變量的均值，“sd”表示其標(biāo)準(zhǔn)差，標(biāo)準(zhǔn)差表征了失調(diào)電壓偏離均值(理論值為0)的程度，即失調(diào)的嚴(yán)重程度。

圖4 加入DCOC電路前后Monte Carlo仿真

由于VGA的輸入輸出阻抗和負(fù)載(接固定增益級(jí)輸入管的柵端)均為容性的，所以通?？疾斓氖切盘?hào)電壓的傳遞情況而不是功率，為了方便仿真和換算，不妨設(shè)置一個(gè)功率源作為VGA的輸入，內(nèi)阻為差分100歐姆，輸出端口設(shè)置125 fF的電容負(fù)載，去模擬寄生電容的情況，對(duì)VGA進(jìn)行線性度仿真。

圖5給出了電路輸入和輸出1 dB壓縮點(diǎn)隨控制電壓變化的情況，從圖中可以看出兩級(jí)VGA的dB線性增益范圍為-29.5～15 dB，輸入P1dB隨增益的增大先變好后變差，與上一小節(jié)的討論相符。我們以輸入P1dB最好的情況對(duì)應(yīng)的增益為中心，取30 dB的增益范圍并保證dB線性良好的區(qū)域，即當(dāng)0.42

繼續(xù)考察輸出P1dB的情況，由于輸入和輸出阻抗都是容性的，所以輸入、輸出P1dB的具體數(shù)值不具備參考意義，這里我們只關(guān)心它的變化情況。我們粗略地認(rèn)為輸出幅度的限制等價(jià)于輸入幅度的限制乘以其對(duì)應(yīng)的增益，所以輸出P1dB隨著增益的增加呈現(xiàn)出一種先增加后穩(wěn)定的情況，我們從輸入P1dB的角度確定的增益范圍落在了輸出P1dB較高的部分，因此從輸出P1dB的角度看這個(gè)增益范圍也是合適的。輸出P1dB最差的情況對(duì)應(yīng)的輸入P1dB為-16.8 dBm，對(duì)應(yīng)的差分輸入幅度為65 mV，此時(shí)兩級(jí)VGA的增益為-15 dB。也就是說(shuō)在我們所選取的增益區(qū)間內(nèi)，兩級(jí)VGA增益為-15 dB時(shí)，輸出P1dB最小。

圖5 輸入和輸出P1dB隨增益變化情況仿真

圖中最優(yōu)區(qū)域是指在滿(mǎn)足dB線性的條件下，選取的線性度最優(yōu)的30 dB增益動(dòng)態(tài)范圍?？偨Y(jié)VGA的各項(xiàng)性能指標(biāo)如表2所示。

表2 VGA性能參數(shù)總結(jié)

2.2 固定增益級(jí)設(shè)計(jì)與仿真

在線性度不被VGA限制的前提，固定增益級(jí)的線性度性能非常重要，對(duì)于多級(jí)結(jié)構(gòu)的放大器來(lái)說(shuō)，越是后級(jí)電路對(duì)線性度的要求就越高，輸出級(jí)只有采用高擺幅的電路結(jié)構(gòu)，才能使得在電源電壓的條件下，輸出幅度達(dá)到450mV也不會(huì)發(fā)生嚴(yán)重失真。

為保證整個(gè)前向通路幅頻特性與VGA大致保持一致，固定增益級(jí)帶寬應(yīng)高于VGA的帶寬，而后級(jí)的ADC電路是可以看作一個(gè)很大的容性負(fù)載，在保證增益的前提下做到100 MHz以上的帶寬是不容易的，這需要很小的輸出阻抗，很高的擺率和很強(qiáng)的帶載能力。為滿(mǎn)足以上這些要求，固定增益級(jí)采用如圖6結(jié)構(gòu)。輸入跨導(dǎo)級(jí)主要用于為后級(jí)電路提供電流，電流流經(jīng)反饋回路時(shí)產(chǎn)生輸出電壓。在圖6中，共模輸入視作VCM交流地，第二級(jí)運(yùn)放輸入端虛短，則有：

VOUT=IIN+·Zf-IIN-·Zf=Gm·VIN·Zf

(1)

所以整個(gè)固定增益級(jí)的增益為：

Aυ=Gm·Zf

(2)

其中:Gm為輸入級(jí)等效跨導(dǎo)，它經(jīng)過(guò)了線性化處理，Zf是反饋網(wǎng)絡(luò)的等效阻抗，所以說(shuō)該電路線性度是很高的。

圖6 固定增益級(jí)電路結(jié)構(gòu)

輸入跨導(dǎo)級(jí)采用全差分結(jié)構(gòu)，能夠較好抑制共模噪聲，引入了源極負(fù)反饋，使得增益是mg的弱函數(shù)，提高了線性度，相較于偽差分結(jié)構(gòu)，它噪聲性能更好，但犧牲了電壓裕度，使得線性度不能無(wú)限制提高，同時(shí)源極負(fù)反饋會(huì)降低輸入級(jí)的增益，這需要仔細(xì)地折衷考慮。

電流源作負(fù)載的差動(dòng)對(duì)增益較高，要求PMOS負(fù)載的飽和電流之和與n型電流源相平衡是不現(xiàn)實(shí)的，需要用共模反饋來(lái)確定共模電壓。在稍后的輸出級(jí)討論中可以知道，由于驅(qū)動(dòng)較大容性負(fù)載，固定增益級(jí)的輸出阻抗很小，所以采用電阻分壓器提取輸出級(jí)的輸出共模電平，與參考電平比較后生成偏置電壓反饋到輸入跨導(dǎo)級(jí)M3和M4的柵極是合適的，因?yàn)殡娮璺謮浩鞯碾娮柚挡恍枰艽缶涂梢院苋菀椎帽容敵鲎杩勾蟮亩?，從而避免開(kāi)環(huán)增益的降低，同時(shí)避免占據(jù)很大面積造成對(duì)襯底產(chǎn)生很大寄生電容。

輸出級(jí)采用電壓-電流反饋運(yùn)算放大器，前饋放大器采用兩級(jí)結(jié)構(gòu)以獲得較高的開(kāi)環(huán)增益，從而使閉環(huán)增益穩(wěn)定，提高了線性度。輸出級(jí)電路的第二級(jí)通過(guò)調(diào)節(jié)適當(dāng)?shù)钠檬蛊涔ぷ髟贏類(lèi)，避免因晶體管的突然截止導(dǎo)致失真，采用推挽式結(jié)構(gòu)以獲得較高的輸出電壓擺幅。

固定增益級(jí)的幅頻特性中，當(dāng)差分負(fù)載為3 pF(后級(jí)ADC所要求的負(fù)載)時(shí)，直流增益26.12 dB，3 dB帶寬可達(dá)444 MHz。

2.3 峰值檢測(cè)器(Peak Detector)設(shè)計(jì)與仿真

AGC環(huán)路也是一種自動(dòng)控制，這種“自動(dòng)”有賴(lài)于對(duì)信號(hào)強(qiáng)度的實(shí)時(shí)檢測(cè)與判斷，有的通過(guò)檢測(cè)信號(hào)的包絡(luò)，有的通過(guò)檢測(cè)信號(hào)的功率，檢測(cè)信號(hào)強(qiáng)度的不同方式對(duì)應(yīng)了不同的檢測(cè)機(jī)制。對(duì)于GSM信號(hào)，它的包絡(luò)不含調(diào)制信息，所以檢測(cè)信號(hào)的包絡(luò)就能反映信號(hào)強(qiáng)度的衰減狀況，采用包絡(luò)檢波器是最合適的；但對(duì)于CDMA、QAM等幅度調(diào)制比較嚴(yán)重的調(diào)制方式，它的包絡(luò)所含的信息很可能會(huì)進(jìn)入環(huán)路產(chǎn)生不該有的增益調(diào)節(jié)，所以均方根檢測(cè)更加合適。平方律檢測(cè)器檢測(cè)的是信號(hào)的功率，而對(duì)數(shù)檢測(cè)器反映的是輸出信號(hào)電壓的對(duì)數(shù)。檢測(cè)方式的選擇取決于信號(hào)的調(diào)制方式和系統(tǒng)的應(yīng)用環(huán)境。

包絡(luò)檢波是最常用的檢測(cè)方式，當(dāng)信號(hào)瞬時(shí)電位增加時(shí)，電路正向?qū)殡娙莩潆?，而在電位減小時(shí)，電路反向截止，電容無(wú)法放電，這樣電容上的電壓就反映了信號(hào)的峰值。一個(gè)典型的峰值檢測(cè)電路如圖7所示。

圖7 峰值檢測(cè)電路

3 版圖設(shè)計(jì)和系統(tǒng)仿真

3.1 版圖設(shè)計(jì)考量

為保證電路失配、噪聲及寄生參數(shù)影響等盡可能小，使電路更加可靠，版圖設(shè)計(jì)應(yīng)注意以下方面。

1)信號(hào)線要盡量短，優(yōu)先選擇上層金屬以減少寄生電阻的影響，并根據(jù)寄生電容的影響來(lái)考慮決定金屬的寬度。重要的信號(hào)線應(yīng)使用接固定點(diǎn)位的金屬進(jìn)行隔離保護(hù)，使噪聲的電場(chǎng)線終止于地線而不是信號(hào)線。差分信號(hào)的走線一定要嚴(yán)格對(duì)稱(chēng)，盡量減少走線的拐角。

2)在重要的模塊(如VGA輸入對(duì)管)加入Guard Ring進(jìn)行保護(hù)，以避免噪聲干擾。同時(shí)大量的襯底接觸可以有效防止栓鎖效應(yīng)。

3)差分晶體管應(yīng)盡可能使用插指、共質(zhì)心等匹配技術(shù)減小器件失配，同時(shí)應(yīng)加入足夠的Dummy管，防止刻蝕和離子注入不均勻。

4)直流電壓與電流偏置要加足夠多的去耦電容，或做成RC低通濾波的形式；電源和地之間，電流鏡的共柵點(diǎn)等均應(yīng)加入足夠去耦電容，減小噪聲和抖動(dòng)的影響，遵循的原則是充分利用版圖的空隙盡可能多地添加，這也有利于最終密度的填充。

5)電源線要在整個(gè)版圖中均勻分布并盡量使用頂層較寬的金屬，使各模塊電路供電均勻，減小電源線上的壓降。版圖要用金屬鋪地，縮小版圖各點(diǎn)間地的電位差。

6)輸入輸出信號(hào)線應(yīng)與高速PAD連接以減小PAD上寄生電容的影響。在條件允許的情況下可慮使用多個(gè)電源PAD，使供電更均勻并減小bonding線的等效電感(可看作多個(gè)電感并聯(lián))。

7)在后仿過(guò)程中嚴(yán)格對(duì)比前仿各個(gè)節(jié)電的直流電平，保證后仿的靜態(tài)工作點(diǎn)和版圖的差分性能，并據(jù)此對(duì)版圖進(jìn)行修改。

3.2 AGC 系統(tǒng)仿真

3.2.1 AGC開(kāi)環(huán)特性仿真

當(dāng)開(kāi)關(guān)S斷開(kāi)時(shí)，AGC處于開(kāi)環(huán)狀態(tài)，人為改變控制電壓CV對(duì)前向通路的增益和線性度進(jìn)行仿真，仿真結(jié)果如圖所示?？梢钥闯鯝GC的dB線性動(dòng)態(tài)范圍是-3.6～41 dB，輸入P1dB范圍是-36.7～-15.0 dBm，對(duì)應(yīng)差分幅度為6.6～79.5 mV，輸出P1dB范圍是-26.7～0.68 dBm，對(duì)應(yīng)差分幅度為56.9～1 331.5 mV；滿(mǎn)足輸出功率壓縮1 dB時(shí)對(duì)應(yīng)的差分幅度大于450 mV的增益范圍是11～41 dB，即該AGC有30 dB的動(dòng)態(tài)范圍滿(mǎn)足線性度的要求。

一般而言放大器的增益越大直流失調(diào)越嚴(yán)重，所以我們對(duì)比加入直流失調(diào)消除電路前后的前向通路在最高增益處的直流失調(diào)的情況。可以看出在未加入直流失調(diào)消除電路時(shí)，失調(diào)已經(jīng)使電路無(wú)法處于正常工作的狀態(tài)了，而加入DCOC后，該AGC很好的抑制了直流失調(diào)的影響，最差情況下的輸出失調(diào)僅為58 mV。

值得注意的是，仿真中的失調(diào)主要來(lái)源與固定增益級(jí)，對(duì)于AGC本身來(lái)說(shuō)，固定增益級(jí)已經(jīng)是整個(gè)信號(hào)通路的最后一級(jí)，本文著重處理了VGA與固定增益級(jí)級(jí)間的失調(diào)，使其不至于造成AGC的輸出失真，而固定增益級(jí)產(chǎn)生的失調(diào)可以交由下級(jí)電路進(jìn)行失調(diào)的消除和矯正。由于直流失調(diào)消除電路對(duì)低頻的抑制作用，整個(gè)AGC的前向通路呈現(xiàn)帶通的特性，當(dāng)增益最高時(shí)，帶寬最小為20.8～155 MHz。

3.2.2 AGC閉環(huán)特性仿真

將圖中的開(kāi)關(guān)S閉合，控制端VC懸空，AGC環(huán)路閉合。設(shè)置AGC的輸入信號(hào)0～40 μs時(shí)差分幅度為4 mV，40～80 μs差分幅度為16 mV，80～120 μs差分幅度為64 mV，觀察AGC的輸出和控制信號(hào)的變化，如圖8所示。

圖8 AGC瞬態(tài)仿真

從圖中可以看出對(duì)于不同幅度的輸入信號(hào)，AGC的輸出均能保持在差分幅度420 mV左右，從輸入信號(hào)發(fā)生跳變到輸出信號(hào)幅度穩(wěn)定所需的時(shí)間大致相同為8 us左右。

為進(jìn)一步觀測(cè)AGC的環(huán)路特性，設(shè)置Vref為從0到800 mV的階躍信號(hào)r(t)=Au(t)，觀察峰值檢測(cè)器輸出電平d(t)的變化，如圖9所示。從階躍響應(yīng)中可以看出該系統(tǒng)的阻尼系數(shù)是比較合理的，在響應(yīng)時(shí)間和穩(wěn)定性上做了較好的折衷。

圖9 AGC階躍響應(yīng)仿真

4 結(jié)論

在無(wú)線接收機(jī)系統(tǒng)中，自動(dòng)增益控制電路(AGC)是一個(gè)非常重要的部分，它通過(guò)檢測(cè)信號(hào)強(qiáng)度自動(dòng)的調(diào)節(jié)可變?cè)鲆娣糯笃?VGA)的增益，從而使輸出保持相對(duì)恒定，有利于對(duì)天線接收到的大動(dòng)態(tài)范圍的信號(hào)進(jìn)行處理。本文設(shè)計(jì)實(shí)現(xiàn)了一種適用于70 MHz中頻信號(hào)的自動(dòng)增益控制電路，在選定了AGC的具體結(jié)構(gòu)之后，給出了AGC電路的整體設(shè)計(jì)方案，對(duì)電路級(jí)設(shè)計(jì)起宏觀指導(dǎo)作用。

根據(jù)系統(tǒng)仿真中的系統(tǒng)指標(biāo)要求逐一對(duì)具體的模塊電路進(jìn)行設(shè)計(jì)，同時(shí)對(duì)AGC中的各個(gè)模塊設(shè)計(jì)做了詳細(xì)的分析與仿真。從增益、線性度、直流失調(diào)、穩(wěn)定性等方面對(duì)電路做了優(yōu)化。基于電路設(shè)計(jì)中得到的具體參數(shù)完成版圖繪制，總結(jié)了版圖設(shè)計(jì)中的一些關(guān)鍵點(diǎn)，最后提取版圖的寄生參數(shù)對(duì)AGC電路做了整體仿真，最終該AGC在滿(mǎn)足輸出信號(hào)幅度和線性度的基礎(chǔ)上達(dá)到了30 dB的動(dòng)態(tài)范圍，滿(mǎn)足了接收機(jī)系統(tǒng)的要求。

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Research on Automatic Gain Control Circuit based on CMOS Process

Liang Juan

(Department of Energy and Electrical Engineering&XinJiang Industrial Vocational and Technical College,Urumqi 830022,China)

In the wireless receiver, antenna receiving signal strength tend to vary greatly, automatic gain control loop (Automatic Gain Control, AGC) according to the signal strength to dynamically control the gain of the amplifier, backward level baseband circuit (such as ADC) to provide a constant amplitude signal, the different intensity of

signal can be received correctly and demodulation. In order to achieve the dynamic adjustment of the amplifier strength of the signal received by the receiver gain recognition, in order to achieve the output signal amplitude is constant, this paper focuses on the TSMC90nm CMOS process for AGC circuit design process of 70 MHz intermediate frequency signal based on the detailed design of the AGC circuit of each module, and in order to improve the linearity, reduce the DC offset and improve the stability. To optimize the circuit layout design, mainly introduces the AGC chip and the imitation, and gives the characteristics and indexes of AGC system. In the circuit design process, the linearity, the output signal amplitude and the gain control range are improved and optimized. Finally, the performance of the AGC loop is verified by simulation, and the dynamic range of the AGC is achieved on the basis of the output signal amplitude and linearity, which meets the requirements of the 30 dB system.

CMOS; AGC; VGA; dB-linear; outputP1dB

2017-03-13；

2017-03-31。

梁 娟(1982-)，女，甘肅人，研究生，新疆工業(yè)職業(yè)技術(shù)學(xué)院,電氣講師，主要從事電氣自動(dòng)化、電子信息方向的研究。

1671-4598(2017)07-0264-05

10.16526/j.cnki.11-4762/tp.2017.07.066

TM417

A